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<project source="3.8.0" version="1.0">
This file is intended to be loaded by Logisim-evolution v3.8.0(https://github.com/logisim-evolution/).
<lib desc="#Wiring" name="0">
<tool name="Splitter">
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</tool>
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</lib>
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<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
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<mappings>
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</mappings>
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<tool lib="0" name="Pin">
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<sep/>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
<tool lib="1" name="XOR Gate"/>
<tool lib="1" name="NAND Gate"/>
<tool lib="1" name="NOR Gate"/>
<sep/>
<tool lib="4" name="D Flip-Flop"/>
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</toolbar>
<circuit name="main">
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<comp lib="0" loc="(80,70)" name="Clock">
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</comp>
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<a name="text" val="Registere kunne egt ha vært en god Main"/>
</comp>
<comp lib="8" loc="(640,75)" name="Text">
<a name="text" val="Skulle ikke aluOut bare gjennom databussen? Blir mye mindre kabling, selv om kanskje fler sykluser per instruksjon"/>
</comp>
<comp loc="(620,160)" name="ALU"/>
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<wire from="(680,200)" to="(680,460)"/>
<wire from="(680,460)" to="(760,460)"/>
</circuit>
<circuit name="Registere">
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<comp lib="0" loc="(230,450)" name="Pin">
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<comp lib="0" loc="(280,20)" name="Tunnel">
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<a name="text" val="Sparer vi ikke sykluser på å loade direkte til databuss? Blir mindre komplisert, siden vi ikke har snakket om noe cashing"/>
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<a name="text" val="La ikke WD til som input i tilfelle dette funker annenleder fra de andre"/>
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<comp lib="3" loc="(500,250)" name="Adder">
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<comp lib="4" loc="(140,140)" name="Register">
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<comp lib="4" loc="(320,90)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="ALU_b"/>
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<comp lib="8" loc="(595,535)" name="Text">
<a name="text" val="Even flag kan slettes om den ikke trengs"/>
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