crazycpu.circ

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    </tool>
    <tool name="Probe">
      <a name="radix" val="16"/>
    </tool>
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  <lib desc="#Gates" name="1">
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    </tool>
    <tool name="OR Gate">
      <a name="facing" val="west"/>
      <a name="size" val="30"/>
      <a name="inputs" val="2"/>
    </tool>
    <tool name="Controlled Buffer">
      <a name="facing" val="north"/>
      <a name="width" val="4"/>
      <a name="control" val="left"/>
    </tool>
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  <lib desc="#Plexers" name="2">
    <tool name="Multiplexer">
      <a name="width" val="4"/>
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    </tool>
    <tool name="Demultiplexer">
      <a name="width" val="16"/>
      <a name="enable" val="false"/>
    </tool>
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  <lib desc="#Arithmetic" name="3">
    <tool name="Adder">
      <a name="width" val="16"/>
    </tool>
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  <lib desc="#Memory" name="4">
    <tool name="Register">
      <a name="width" val="4"/>
      <a name="label" val="Hnib"/>
    </tool>
    <tool name="Counter">
      <a name="label" val="PC"/>
    </tool>
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    <tool name="ROM">
      <a name="addrWidth" val="13"/>
      <a name="contents">addr/data: 13 8
0
</a>
    </tool>
  </lib>
  <lib desc="#I/O" name="5"/>
  <lib desc="#Base" name="6">
    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <main name="main"/>
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    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
  </options>
  <mappings>
    <tool lib="6" map="Button2" name="Menu Tool"/>
    <tool lib="6" map="Button3" name="Menu Tool"/>
    <tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="6" name="Poke Tool"/>
    <tool lib="6" name="Edit Tool"/>
    <tool lib="6" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin">
      <a name="width" val="8"/>
      <a name="tristate" val="false"/>
      <a name="label" val="Dreaders"/>
    </tool>
    <tool lib="0" name="Pin">
      <a name="output" val="true"/>
      <a name="width" val="2"/>
      <a name="label" val="PARena"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
  </toolbar>
  <circuit name="main">
    <a name="circuit" val="main"/>
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    <comp lib="0" loc="(70,420)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="8"/>
      <a name="label" val="Address"/>
    </comp>
    <comp lib="0" loc="(220,210)" name="Clock">
      <a name="facing" val="north"/>
    </comp>
    <comp lib="0" loc="(180,180)" name="Probe">
      <a name="facing" val="north"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="1" loc="(250,510)" name="Controlled Buffer">
      <a name="facing" val="north"/>
      <a name="width" val="4"/>
      <a name="control" val="left"/>
    </comp>
    <comp lib="0" loc="(160,520)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RAMwrite"/>
    </comp>
    <comp lib="0" loc="(580,40)" name="Tunnel">
      <a name="label" val="PCincr"/>
    </comp>
    <comp lib="0" loc="(320,370)" name="Tunnel">
      <a name="label" val="Aload"/>
    </comp>
    <comp lib="0" loc="(590,340)" name="Splitter">
      <a name="incoming" val="8"/>
      <a name="appear" val="center"/>
      <a name="bit1" val="0"/>
      <a name="bit2" val="0"/>
      <a name="bit3" val="0"/>
      <a name="bit4" val="1"/>
      <a name="bit5" val="1"/>
      <a name="bit6" val="1"/>
      <a name="bit7" val="1"/>
    </comp>
    <comp lib="0" loc="(180,50)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="8"/>
      <a name="label" val="Address"/>
    </comp>
    <comp lib="6" loc="(509,297)" name="Text">
      <a name="text" val="ALUROM"/>
    </comp>
    <comp lib="0" loc="(320,490)" name="Tunnel">
      <a name="label" val="Bload"/>
    </comp>
    <comp lib="0" loc="(580,100)" name="Tunnel">
      <a name="label" val="Asel"/>
    </comp>
    <comp lib="0" loc="(410,240)" name="Tunnel">
      <a name="width" val="3"/>
      <a name="label" val="ALUop"/>
    </comp>
    <comp lib="0" loc="(580,150)" name="Tunnel">
      <a name="width" val="8"/>
      <a name="label" val="Address"/>
    </comp>
    <comp lib="5" loc="(690,380)" name="TTY">
      <a name="rows" val="25"/>
      <a name="cols" val="100"/>
      <a name="bg" val="#c9c9c940"/>
    </comp>
    <comp lib="1" loc="(750,430)" name="NOT Gate">
      <a name="facing" val="west"/>
      <a name="size" val="20"/>
    </comp>
    <comp lib="0" loc="(260,180)" name="Probe">
      <a name="facing" val="north"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="4" loc="(350,300)" name="Register">
      <a name="width" val="4"/>
      <a name="label" val="A"/>
    </comp>
    <comp lib="1" loc="(240,520)" name="NOT Gate">
      <a name="size" val="20"/>
    </comp>
    <comp lib="0" loc="(160,220)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RAMwrite"/>
    </comp>
    <comp lib="0" loc="(580,60)" name="Tunnel">
      <a name="label" val="Aload"/>
    </comp>
    <comp lib="4" loc="(590,340)" name="ROM">
      <a name="addrWidth" val="13"/>
      <a name="contents">addr/data: 13 8
4 10 20 30 40 50 60 70
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6*4 30 40 50 60 70 80 90
5 11 21 6*4 40 50 60 70
80 90 5 11 21 31 6*4 50
60 70 80 90 5 11 21 31
41 6*4 60 70 80 90 5 11
21 31 41 51 6*4 70 80 90
5 11 21 31 41 51 61 6*4
80 90 5 11 21 31 41 51
61 71 6*4 90 5 11 21 31
41 51 61 71 81 103*4 91 81
71 61 51 41 31 21 11 6*4
10 4 91 81 71 61 51 41
31 21 6*4 20 10 4 91 81
71 61 51 41 31 6*4 30 20
10 4 91 81 71 61 51 41
6*4 40 30 20 10 4 91 81
71 61 51 6*4 50 40 30 20
10 4 91 81 71 61 6*4 60
50 40 30 20 10 4 91 81
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10 4 91 81 6*4 80 70 60
50 40 30 20 10 4 91 6*4
90 80 70 60 50 40 30 20
10 120*4 10 4 10 4 10 4
10 4 10 4 10 4 10 4
10 4 4 20 20 4 4 20
20 4 4 20 20 4 4 20
20 4 10 20 30 4 10 20
30 4 10 20 30 4 10 20
30 4*4 4*40 4*4 4*40 4 10 4
10 40 50 40 50 4 10 4
10 40 50 40 50 4 4 20
20 40 40 60 60 4 4 20
20 40 40 60 60 4 10 20
30 40 50 60 70 4 10 20
30 40 50 60 70 8*4 8*88 4
10 4 10 4 10 4 10 88
98 88 98 88 98 88 98 4
4 20 20 4 4 20 20 88
88 a8 a8 88 88 a8 a8 4
10 20 30 4 10 20 30 88
98 a8 b8 88 98 a8 b8 4*4
4*40 4*88 4*c8 4 10 4 10 40
50 40 50 88 98 88 98 c8
d8 c8 d8 4 4 20 20 40
40 60 60 88 88 a8 a8 c8
c8 e8 e8 4 10 20 30 40
50 60 70 88 98 a8 b8 c8
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50 60 70 88 98 a8 b8 c8
d8 e8 f8 10 10 30 30 50
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f8 d8 d8 f8 f8 e8 f8 e8
f8 e8 f8 e8 f8 e8 f8 e8
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f8 d8 d8 f8 f8 e8 f8 e8
f8 e8 f8 e8 f8 e8 f8 e8
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9 a b c d e f 0
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98 a8 b8 c8 d8 e8 f8 4
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98 a8 b8 c8 d8 e8 f8 4
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98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
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98 a8 b8 c8 d8 e8 f8 4
10 20 30 40 50 60 70 88
98 a8 b8 c8 d8 e8 f8 4
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98 a8 b8 c8 d8 e8 f8 4
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50 aa 4 50 aa 4 50 a8
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60 ca 30 9a 4 60 ca 30
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70 ea 60 da 50 ca 40 b8
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c8 98 60 30 4 c8 98 62
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4 10 10 20 20 30 30 42
52 52 62 62 72 72 88 4
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52 62 62 72 88 88 98 4
4 10 20 20 30 40 40 52
62 62 72 88 88 98 a8 4
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70 8a 9a aa b8 c8 d8 e8
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8a 9a aa ba c8 d8 e8 f8
5 11 21 31 50 60 70 8a
9a aa ba ca d8 e8 f8 5
11 21 31 41 60 70 8a 9a
aa ba ca da e8 f8 5 11
21 31 41 51 70 8a 9a aa
ba ca da ea f8 5 11 21
31 41 51 61 8a 9a aa ba
ca da ea fa 5 11 21 31
41 51 61 71 98 a8 b8 c8
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e8 f8 5 11 23 33 43 53
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f8 5 11 21 33 43 53 63
73 89 99 a9 c8 d8 e8 f8
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21 31 41 51 63 73 89 99
a9 b9 c9 d9 f8 5 11 21
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41 51 61 71 89 99 a9 b9
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bb ab 9b 8b 71 61 51 41
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cb bb ab 9b 89 71 61 51
41 31 21 11 10 4 fb eb
db cb bb ab 99 89 71 61
51 41 31 21 20 10 4 fb
eb db cb bb a9 99 89 71
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c8 d8 e8 f8 4 10 20 30
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c8 d8 e8 f8 4 10 20 30
40 50 60 70 88 98 a8 b8
c8 d8 e8 f8 4 10 20 30
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40 50 60 70 88 98 a8 b8
c8 d8 e8 f8 4 10 20 30
40 50 60 70 88 98 a8 b8
c8 d8 e8 f8 4 10 20 30
40 50 60 70 88 98 a8 b8
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c8 d8 e8 f8 4 10 20 30
40 50 60 70 88 98 a8 b8
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e8 4 4 10 4 30 4 30
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6
</a>
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e8 d8 38 e8 d8 38 e8 d8
38 b8 d8 a8 88 d8 88 d8
88 d8 88 98 88 e8 7a e8
7a e8 7a e8 7a e8 7a e8
7a e8 7a e8 7a b0 a8 7a
7a a8 5*7a a8 7a 7a a8 7a
a8 7a a8 7a a8 7a e8 7a
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79 e8 7a e8 7a 3f e8 d8
78 e8 d8 78 3f a8 d8 78
a8 d8 78 e8 d8 88 3f e8
d8 79 e8 d8 79 b0 e8 d8
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a8 7a 7a e8 d8 38 e8 d8
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d8 a8 88 d8 88 d8 88 d8
88 98 88 e8 7a e8 7a e8
7a e8 7a e8 7a e8 7a e8
7a e8 7a b0 a8 7a 7a a8
5*7a a8 7a 7a a8 7a a8 7a
a8 7a a8 7a e8 7a e8 7a
3f e8 d8 79 e8 d8 79 e8
7a e8 7a 3f e8 d8 78 e8
d8 78 3f a8 d8 78 a8 d8
78 e8 d8 88 3f e8 d8 79
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d8 88 b0 138*0 a8 6*7a a8 7a
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88 e8 7a e8 7a e8 7a e8
7a e8 7a e8 7a e8 7a e8
7a b0 a8 7a 7a a8 5*7a a8
7a 7a a8 7a a8 7a a8 7a
a8 7a e8 7a e8 7a 3f e8
d8 79 e8 d8 79 e8 7a e8
7a 3f e8 d8 78 e8 d8 78
3f a8 d8 78 a8 d8 78 e8
d8 88 3f e8 d8 79 e8 d8
79 b0 e8 d8 88 e8 d8 88
b0 138*0 a8 6*7a a8 7a 7a e8
d8 38 e8 d8 38 e8 d8 38
e8 d8 38 b0 d8 a8 88 d8
88 d8 88 d8 88 98 88 e8
7a e8 7a e8 7a e8 7a e8
7a e8 7a e8 7a e8 7a b0
a8 7a 7a a8 5*7a a8 7a 7a
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7 1 4 8 4 8 c 3
7 b 2 6 a 1 5 9
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c 0 a ff 8 4 c 8
7 3 b 7 6 2 a 6
5 1 9 5 a 2 8 a
0 c 9 e 2 3 a b
d f f 1 10 3 0 6
1 0 4 f 5 ff 3 4
3 2 5 2 2 4 f 5
ff 1 4 1 0 5 0 ff
b 1 7 3 0 6 8 9
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8a 8b 8a 8b 8b 8c 8b 8c
8c 8d 8c 8d 8d 8e 8d 8e
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89 8a 89 8a 8a 8b 8a 8b
8b 8c 8b 8c 8c 8d 8c 8d
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a8 a9 a8 a9 a9 aa a9 aa
8a 8b 8a 8b 8b 8c 8b 8c
8c 8d 8c 8d 8d 8e 8d 8e
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8d 8e 8d 8e 8e 8f 8e 8f
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a8 a9 a8 a9 a9 aa a9 aa
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a9 aa a9 aa aa ab aa ab
ab ac ab ac ac ad ac ad
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a8 a9 a8 a9 a9 aa a9 aa
aa ab aa ab ab ac ab ac
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10 11 50 11 11 12 11 12
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7 a8 7 a8 a8 a9 a8 a9
a9 aa a9 aa aa ab aa ab
ab ac ab ac ac ad ac ad
ad ae ad ae ae af ae af
8f 10 8f 50 10 11 50 11
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